verilog三維陣列
我用過的Tool都沒辦法合成3維的,只能用2D, 然後自己去算Address,不過你的陣列大小是2的power, 所以把他接起來就好了wire signed Y0 [17:0] ...,我用過的Tool都沒辦法合成3維的, 只能用2D, 然後自己去算Address, 不過你的陣列大小是2的power, 所以把他接起來就好了reg signed [17:0] out_p ...
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